VLSI Korea
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팀 가이드: PDK / Device Modeling — 파운드리의 SPICE 모델·DRC 룰을 만드는 팀
삼성 파운드리·SK하이닉스·DB하이텍이 운영하는 PDK / Device Modeling 팀은 SPICE 모델, DRC/LVS 룰, 라이브러리·테크파일 같은 '공정의 사용 설명서'를 만든다. 한국에서 자리는 좁지만 들어가면 매우 비싼 인재가 되는 트랙. 일상·기술 스택·연봉·이직 시장 가치를 현직자 시점으로 정리한다.
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팀 가이드: Low-Power / Power Architecture — 모바일·AI 칩의 전력 설계자
Low-Power / Power Architecture 팀은 칩이 배터리·발열 한계 안에서 동작하도록 RTL부터 사인오프까지 전력을 설계합니다. UPF로 power domain을 그리고 MTCMOS·DVFS·retention flop 같은 기법을 칩 전체에 강제하는 일이 본업이고, 모바일 AP·AI 가속기·자동차 SoC에서 배터리 시간과 thermal envelope를 결정합니다. 이 글에서는 한국 반도체 회사 기준으로 이 팀의 진짜 일상, 기술 스택, 1~5년차 성장 곡선, 2026년 연봉 범위, 그리고 어떻게 진입하는지를 현직자
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팀 가이드: Formal Verification — 시뮬레이션이 못 잡는 corner를 수학으로 증명한다
Formal Verification은 시뮬레이션처럼 자극을 흘려보지 않고, RTL의 properties를 수학적으로 증명한다. JasperGold나 VC Formal을 켜놓고 cache coherence, arbiter fairness, X-propagation, security isolation 같은 corner case를 tapeout 전에 잡아내는 팀이다. 이 글은 한국 반도체 회사에서 Formal 팀이 실제로 어떤 위치에 있고, 신입부터 5년차까지 무엇을 배우며, 시장에서 얼마를 받는지 솔직하게 정리한다.
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팀 가이드: Architecture / Microarchitecture — 칩의 뼈대를 그리는 사람들
VLSI Korea 팀 가이드의 Architecture 편. 칩의 ISA·파이프라인·캐시·NoC 같은 큰 뼈대를 RTL 작성 전에 결정하고 perf 모델링으로 검증하는 가장 upstream 팀이다. 한국 내 본격 CPU arch 자리가 좁다는 현실, NPU 스타트업과 미국 이직이라는 두 갈래 옵션, 그리고 신입~시니어까지의 연봉·성장 곡선을 정직하게 정리한다.
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팀 가이드: STA (Static Timing Analysis) — tapeout 직전 마지막 게이트키퍼
STA(Static Timing Analysis)팀은 칩이 fab으로 가기 직전 마지막으로 'OK' 도장을 찍는 sign-off 조직이다. PrimeTime/Tempus 리포트와 ECO 패치를 무한히 반복하며 setup/hold violation을 0으로 떨어뜨린다. 한국 반도체 취준생과 5년차 이내 주니어를 위한 STA 팀 현직자 가이드.
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팀 가이드: Physical Design (Backend / PnR) — RTL을 실제 layout으로
Synthesis부터 PnR, signoff까지. RTL을 GDS로 바꾸는 Physical Design 팀의 실제 하루, EDA 툴 스택, 1년차에서 시니어까지의 성장 곡선, 그리고 한국 시장에서의 이직 가치를 정직하게 정리합니다.
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팀 가이드: Design for Test (DFT) — 칩이 죽었는지 살았는지 가려내는 팀
반도체 회사 DFT 팀의 진짜 하루, 1~5년차 성장 곡선, 한국과 글로벌 이직 시장에서의 평가, 2026년 연봉 가이드, 그리고 입사 전 미리 봐두면 좋은 책과 오픈소스 프로젝트까지. 취준생과 5년차 이내 주니어를 위한 VLSI Korea 팀 가이드 시리즈.
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DV (Design Verification) 팀 가이드 — 반도체 검증 엔지니어의 일과 커리어
DV 엔지니어의 검증 계획, 테스트벤치, assertion·coverage와 실패 분석을 살펴봅니다. 시뮬레이션과 formal 검증의 범위를 구분하고, 공식 자료와 재현 가능한 학습 과제로 연결합니다.
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팀 가이드: RTL Design — Verilog로 칩의 뼈대를 짜는 팀
RTL Design팀은 아키텍트의 스펙을 Verilog/SystemVerilog 코드로 옮기는 자리다. 칩 설계 파이프라인의 출발점이고, 한국 반도체 회사에서 인력 수요가 가장 두꺼운 팀 중 하나. 이 글은 진짜 하루, 핵심 기술 스택, 1-5년차 성장 곡선, 한국 시장 연봉과 이직 옵션, 진입 장벽까지 현직자 시점으로 정리한다.